可重构阵列的同步性能优化算法

可重构多处理器阵列上的容错技术可用来重构含有故障单元的处理器阵列，以便获得最大可用的目标阵列。现有的研究成果主要侧重于重构算法的构造，还没有涉及对重构后目标阵列的同步通讯性能的研究。提出了一种改善目标阵列同步通讯性能的电路优化算法，用来降低目标阵列行与行之间通讯的延时，使得相部两行处理器的通讯尽可能达到同步。实验结果表明，提出的算法对不同大小、不同故障率的阵列都有相应的同步通讯性能的改善。